設計・開発エンジニア（半導体）
最大手ファンダリーのLayout Engineer/Manager
の転職・求人情報はすでに掲載終了しております。（掲載期間11月29日～12月12日）
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掲載時の募集要項（掲載期間：2024/11/29 ～ 2024/12/12）
設計・開発エンジニア（半導体）
最大手ファンダリーのLayout Engineer/Manager
管理職・マネジャー
英語力不問
転勤なし
土日祝休み
募集要項
仕事内容
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* RDR design rules optimization.
* Develop Standard Cell/IO Library Memory and Analog IPs in advanced technology.
* Develop Memory IPs, Compiler and Test Vehicle.
* Develop Standard Cell/IO Library and Analog. IPs
* Provide design rules trade-off on area and performance.
* Find layout solution for Standard Cell/IO Library Memory and Analog IPs to reduce RDR impact on area.
<コンサルタントメッセージ>
ビジネス好調な世界最大手のファンダリーでご活躍頂けます。
応募資格
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- 必須
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求める学歴：大学卒以上
* BCH and above degree in EE or Engineering related field with 3+ years of working experiences.
* Expertise on std. Cell, SRAM, IO and analog layout and familiar with customers usage on those IPs.
* Layout expertise of SRAM (first priority), Standard cell, IO, Analog, Process and Device background will be a plus.
* Be able to communicate with customer in English is a plus.
雇用形態
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正社員 ※試用期間3ヶ月
勤務地
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神奈川県 横浜 ※転勤なし
年収・給与
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年収：1000万円～1200万円
待遇・福利厚生
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各種完備
休日休暇
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週休2日（土日）、祝日休、夏休み、年末年始休
会社概要
社名
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非公開
事業内容・会社の特長
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1987年に設立された世界最大の半導体専業ICファンドリーメーカーです。
専業ICファンドリー事業の創始者として、また専業ICファンドリーのビジネスモデルの牽引する企業として、最先端及び "More-than-Moore" のウェーハ・プロセス製造技術や卓越した製造効率を提供するなど高い評価を得てきました。
創業時より一貫してファンドリー業界をリードする最先端技術と、設計サービスをお客様に提供しています。
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