募集要項
- 募集背景
- 今後さらなる事業成長と組織強化を見据え、ベテラン社員から若手社員への技術継承を推進するため、新たな仲間をお迎えすることになりました。
- 仕事内容
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電気系設計開発をお任せします。装置の心臓部であるFPGA領域を中心に、将来的にはシステム設計や周辺回路まで幅広く携われる環境です。●FPGA仕様検討と種類選定
装置へ搭載する基板の目標スペックに基づいたFPGAの選定、仕様検討
外注へFPGA実装・評価依頼するためのFPGA仕様書の作成
●FPGA論理回路設計・実装・シミュレーション・実機デバッグ
Verilog HDL、VHDL等による論理回路設計、コーディング
論理回路の設計
●関係するドキュメント作成、設計レビュー
仕様書・評価結果等のドキュメント作成と設計内容に関する社内の設計レビュー対応
◎る回路設計や基板設計、将来的には周辺回路やシステム設計まで領域を広げられます。
＜開発環境＞
●Quartus、Vivado、ISE等
●Verilog HDL、VHDL
■この仕事で得られるもの
経験豊富なベテラン技術者と若手技術者の間に立ち、技術を吸収しながら次世代へ伝承していく架け橋としての確かな貢献実感や、プロジェクトリーダー・スペシャリストへと歩みを進める成長実感を深く味わえます。
■教育・キャリア
入社後はグループ内でテーマを設定した勉強会を定期的に開催し、業務の進捗状況を確認しながら必要に応じた勉強会も随時実施します。社内外のセミナー受講も推奨しており、手厚い学習機会を用意。将来的にはプロジェクトリーダーとして開発全体を牽引する道や、高度な技術を極めるスペシャリストの道など、希望に応じたキャリアを歩めます。
【将来的に従事する可能性のある仕事内容】
同社業務全般
【所属部署情報】
・所属部署：エレキ技術課
・所属人数：5名
- 応募資格
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- 必須
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・FPGA論理回路設計の実務経験（Verilog HDLまたはVHDLを用いた経験1年以上）
・FPGA開発環境（Quartus、Vivado、ISEなど）の使用経験
・実機および計測器を使用したデバッグ経験
- 雇用形態
- 正社員
- 勤務地
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青森県
＜将来的に勤務する可能性のある場所＞
本社および全ての支社、営業所
＜受動喫煙防止策＞
屋内全面禁煙、屋外に喫煙所を設置
- 勤務時間
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固定労働時間制 所定勤務時間：08:45～17:30
実働時間：7時間45分
休憩時間：1時間
月平均残業時間：10時間～20時間
- 年収・給与
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年収：500～750 万円
月給制
基本給：260000円～400000円
残業代：全額支給
変動手当：家族手当
住宅手当
語学能力手当
技能手当
月給：260,000円～400,000円
通勤手当：あり 実費支給(上限なし)
賞与：あり 年2回（昨年度実績：7.42か月分）
昇給：あり 年1回
- 待遇・福利厚生
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保険・共済（慶弔見舞金制度、団体扱い生命保険・損害保険）
財産形成 （財形貯蓄制度、社員持株制度、確定拠出年金制度）
健康管理 （人間ドック補助、定期健康診断）
各種補助貸付制度 （社員旅行補助、社員貸付金制度）
退職金制度
育児・介護のための短時間勤務制度
グローバル人材育成制度 （語学研修、語学留学）
各種研修制度（新卒1・3・5年目フォローアップ研修、階層別研修、目的別研修）
自己啓発関連講座補助制度 ほか
- 休日休暇
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【年間休日】122日
【休日内訳】 完全週休2日制 土曜日,日曜日,祝日,夏季休暇,年末年始休暇,産前・産後休暇,育児休暇,介護休暇,特別休暇
- 選考プロセス
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面接2回（適性検査あり）
※選考フローは変動する可能性があります。
